长鑫存储模拟IP开发主任工程师(PDK)-Analog IP Design Staff Engineer(PDK)(J19084)
社招全职5年以上电路设计类地点：合肥 | 上海状态：招聘
任职要求
1. 教育背景与专业知识：硕士及以上学历，微电子或电气工程等相关专业； 2. 专业技能与资格：能使用Cadence Virtuoso、Spectre/Hspice、Finesim/Hsim等模拟设计工具完成电路设计与仿真，能使用Python、Skill等脚本语言进行设计流程自动化； 3. 行业与专业经验：5年及以上模拟/混合信号IC设计经验，具备成功流片记录，并具有核心模拟I…
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工作职责
1. PDK验证与优化：主导或参与新工艺PDK（模拟/射频部分）的test chip设计、仿真及硅后验证，确保PDK模型、规则及单元的准确性与可靠性，提供设计反馈以提升PCell、仿真模型及设计规则实用性； 2. 设计导向的PDK支持与问题解决：作为PDK团队的技术接口，为设计团队提供深度技术咨询，排查模拟IP开发中与PDK相关的复杂问题（如模型精度、设计规则解读），并编写PDK应用指南及最佳实践文档； 3. DTCO协作与设计可行性研究：与工艺及设计团队协作，应用设计与工艺协同优化方法，通过实际电路设计案例评估工艺节点的性能、面积与功耗潜力，为工艺选择及PDK功能定义提供数据支持； 4. 设计流程与工具优化：主导开发并优化面向PDK的模拟设计流程、验证方法及自动化脚本，提升整体设计效率。
包括英文材料
学历+
Cadence+
https://www.youtube.com/user/CadenceDesign
Cadence is a pivotal leader in electronic systems design, building upon more than 30 years of computational software expertise.
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1. 模拟IP电路设计与优化：主导BG、LDO、PLL、ADC等基本模拟IP的电路设计，优化功耗、性能与面积竞争力，结合工艺特点制定完整的测试与验证方案； 2. 仿真验证与sign-off：使用模拟设计EDA工具完成前仿与后仿验证，通过脚本加速仿真自动化流程，确保设计满足sign-off标准； 3. 测试与量产支持：制定模拟IP的功能测试方案，配合测试工程团队完成芯片测试，分析量产数据并推动设计优化； 4. 技术文档与方案沉淀：编写设计规格书、测试计划及表征报告，系统化归档设计经验与IP复用资料； 5. 新技术预研与适配：跟踪新工艺与新技术趋势，解析新标准并评估其对模拟IP设计的影响，推动技术迭代。
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