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长鑫存储SRAM器件研发工程师 | SRAM Device Engineer(J15100)

社招全职1年以上研发技术类地点:合肥状态:招聘

任职要求


1.具有微电子,物理,材料等工科相关专业硕士研究生及以上学位; 
2.一年及以上SRAM cell design/Device/HTOL相关经验;
3.具有FinFET工艺及器件开发经验者优先;
4.工作态度积极认真,具有良好的团队协作能力;
5.具备良好的数据分析能力,良好的报告书写和讲演能力。

工作职责


1.负责当前节点SRAM bitcell的design, 设计出符合工艺开发的cell,包含不限于HD/HC/2P/DP cell;
2.与Design部门对接, 明确关键电路设计需求和电性改善方向,建立高质量Model;
3.与PIE/UPD部门对接,提出明确MTS和EDR,并建立监测流程; 
4.与PTE/YE部门对接,针对fail bit类型/defect关联指导并定位SRAM相关工艺方向提升良率;
5.与QRA部门对接,解析相关HTOL问题,提出并且落实改善方案。
包括英文材料
学历+
数据分析+
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社招5年以上工艺技术类

1. 负责SRAM基本单元测试结构设计,测试芯片的良率分析以及器件/工艺优化; 2. 负责建立SRAM SPICE model, 3. 根据需求对SRAM基本单元的功耗,性能和面积进行仿真设计和优化,并进行技术文档的编写,维护等工作 4. 负责和制程整合,器件设计,版图设计以及电路设计等相关部门进行跨部门沟通协作,完成SRAM测试芯片的整个研发流程。

更新于 2025-02-08
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社招3年以上N6823

1、设计芯片中常用的基础数字IP; 2、涉及IP包括:特殊优化方向的标准单元(面积或者功耗),定制SRAM,Big Inverter,动态Latch等小型数字IP; 3、完成IP的电路设计工作并且协助版图工程师完成版图设计。

更新于 2022-05-30
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校招芯片序列

1、负责先进工艺下(16nm,12nm,7nm,5nm,3nm)StdCell、SRAM library等电路定制,优化以及质量看护工作。 2、根据项目需求负责StdCell、SRAM不同PVT corner的timing library的reK工作。 3、负责制定、优化先进工艺的STA Timing Signoff策略以达成最佳PPACY。 4、对了解先进工艺制程,负责芯片的Critical Path、Htree/Mesh Clock,aging 等仿真工作。 5、辅助硅后测试分析与诊断,并完成工艺和设计方案对齐和调优工作。

更新于 2025-07-01
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社招2年以上电路设计类

职责: 1、设计与存储单元阵列相关的核心电路,并开发DRAM通用IP。 2、评估并优化高性能DDR和LPDDR的内存架构。 3、模拟、验证和分析电路功能和性能。 4、协助建立设计流程和质保流程。 5、监督布局和验证过程,包括布局规划、布局和布线;并指导布局工程师进行布局开发。 6、为产品工程部门提供硅调试方面的支持。

更新于 2025-09-12