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小米芯片DFT设计工程师

社招全职A159109地点:西安状态:招聘

任职要求


1.微电子、计算机等相关专业硕士及以上学历 
2.具有扎实的数字电路理论基础,熟悉数字电路IC设计流程 
3.掌握Verilog语言,静态时序分析概念清晰 
4.熟悉DFT相关EDA工具(如Mentor/Synopsys) 
5.熟悉脚本语言,tcl,perl,或python 
6.具有良好的沟通与组织协调能力

工作职责


1.完成SOC芯片DFT设计工作,Bist,Jtag,Scan,ATPG等 
2.完成DFT方案,设计,仿真,时序分析等 
3.负责芯片投片前各项signoff检查 
4.参与先进工艺的导入,诊断良率问题,催熟工艺达成量产目标
包括英文材料
学历+
脚本+
Perl+
Python+
相关职位

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社招A104846

1.完成SOC芯片DFT设计工作,Bist,Jtag,Scan,ATPG等 2.完成DFT方案,设计,仿真,时序分析等 3.负责芯片投片前各项signoff检查 4.参与先进工艺的导入,诊断良率问题,催熟工艺达成量产目标

更新于 2024-11-25
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社招电路设计类

1.芯片级DFT架构定义和设计:参与芯片DFT架构的定义和设计,确保芯片设计满足可测试性要求。 2.采用全定制电路设计方法和低功耗电路设计方法学完成DFT电路设计、仿真和优化等工作,包括压缩测试模式、MBIST(Memory Built-In Self-Test)等。 3.协助测试工程师进行ATE(Automatic Test Equipment)silicon分析,debug测试failure,提高芯片良率。 4.负责DRAM DFT设计与测试软硬件协同,帮助实现测试效率提升和测试成本缩减。 5.与其他团队协作:包括指导版图团队进行相关电路布局布线、协同验证团队进行电路调试和问题解决、与测试团队合作进行DFT需求管理与设计实现等。

更新于 2025-09-19
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社招3年以上ACG

-负责制定SOC/ASIC芯片的DFT设计方案和测试方案 -负责DFT电路的实现和验证,优化DFT设计流程,包括MBIST、SCAN、Boundary Scan以及其它可测试性电路设计 -pattern生成和仿真,优化测试覆盖率 -协助团队完成整个芯片的sign-off -与ATE测试团队配合快速解决调试过程中的问题,协助完成测试failure的分析和良率提升,顺利实现芯片量产测试

更新于 2025-03-31
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社招2年以上

1. 参与制定完整的SoC芯片DFT方案; 2. 完成DFT电路设计,包括Scan、Mbist、Bscan、Lbist; 3. 完成DFT模式的时序约束,协助完成DFT模式的时序收敛; 4. 完成DFT电路的功能验证; 5. 参与芯片bring-up调试; 6. 参与芯片的良率提升以及故障分析。

更新于 2023-08-30