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长江存储IP数字电路设计(J13644)

社招全职5年以上电路设计类地点:武汉 | 上海状态:招聘

任职要求


1. 5年以上ASIC数字电路设计相关工作经验,有流片经验;
2. 有负责复杂IP开发的经验,能胜任从spec定义到流片量产各阶段的相应任务;
3. 硕士及以上学历,微电子/电子信息/电子工程等相关专业;
4. 精通数字电路设计全流程,熟悉Verilog、Systemverilog等RTL语言,熟悉相关工具。

工作职责


控制器SoC芯片中核心IP开发,包括:
1. 负责定义IP的接口、功能、架构等;
2. 负责IP开发设计及性能评估;
3. 支持相关团队,配合完成IP的验证测试、SoC集成、后端设计等工作。
包括英文材料
学历+
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社招2年以上电路设计类

职责: 1、设计与存储单元阵列相关的核心电路,并开发DRAM通用IP。 2、评估并优化高性能DDR和LPDDR的内存架构。 3、模拟、验证和分析电路功能和性能。 4、协助建立设计流程和质保流程。 5、监督布局和验证过程,包括布局规划、布局和布线;并指导布局工程师进行布局开发。 6、为产品工程部门提供硅调试方面的支持。

更新于 2025-09-12
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校招芯片序列

1.承担地平线智能驾驶SOC关键IP的技术竞争力提升和自研落地; 2.主导SOC关键IP的方案及微架构定义,RTL自研开发和交付; 3.负责SOC系统及关键IP的PPA评估和优化,构建领先业界的竞争力; 4.参与地平线智能驾驶SOC需求规格和系统架构分析,与业界优秀架构师紧密协作; 5.与验证、实现、后端、底软紧密配合,完成芯片端到端量产交付。

更新于 2025-06-30
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实习实习生

1、参与SoC/IP 系统/子系统的设计和实现; 2、负责模块架构设计、RTL实现、时序分析优化以及模块的PPA优化; 3、支撑 SoC/IP 的系统集成,以及文档编写; 4、与性能分析团队一起进行芯片性能改进; 5、与设计验证团队一起制定验证测试计划,覆盖率分析,芯片仿真以及调试。

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校招应届生

1、参与SoC/IP 系统/子系统的设计和实现; 2、负责模块架构设计、RTL实现、时序分析优化以及模块的PPA优化; 3、支撑 SoC/IP 的系统集成,以及文档编写; 4、与性能分析团队一起进行芯片性能改进; 5、与设计验证团队一起制定验证测试计划,覆盖率分析,芯片仿真以及调试。